SoC Encounter RTL-to-GDSII System

brand:Cadence
Description:整合了RTL综合、芯片虚拟原型、自动布局综合、时钟树综合、可制造性设计与良率设计、低功耗和混合信号设计、还有纳米级布线。使得工程师可以在设计周期的开始就可以综合出一个平展式的虚拟原型实现。
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Lead-free status/ROHS: Yes
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